마인드 맵 갤러리 제6장 버스
Chapter 6 버스에 대한 마인드맵입니다. 버스는 여러 구성요소가 시분할 방식으로 공유할 수 있는 공공정보 전송선의 집합입니다.
2024-01-16 15:54:19에 편집됨이것은 (III) 저산소증-유도 인자 프롤릴 하이드 록 실라 제 억제제에 대한 마인드 맵이며, 주요 함량은 다음을 포함한다 : 저산소증-유도 인자 프롤릴 하이드 록 실라 제 억제제 (HIF-PHI)는 신장 빈혈의 치료를위한 새로운 소형 분자 경구 약물이다. 1. HIF-PHI 복용량 선택 및 조정. Rosalasstat의 초기 용량, 2. HIF-PHI 사용 중 모니터링, 3. 부작용 및 예방 조치.
이것은 Kuka Industrial Robots의 개발 및 Kuka Industrial Robot의 모션 제어 지침에 대한 마인드 맵입니다. 주요 내용에는 쿠카 산업 로봇의 역사, 쿠카 산업 로봇의 특성, 쿠카 산업 로봇의 응용 분야, 2. 포장 프로세스에서 쿠카 로봇은 빠르고 일관된 포장 작업을 달성하고 포장 효율성을 높이며 인건비를 줄입니다. 2. 인건비 감소 : 자동화는 운영자에 대한 의존성을 줄입니다. 3. 조립 품질 향상 : 정확한 제어는 인간 오류를 줄입니다.
408 컴퓨터 네트워크가 너무 어렵습니까? 두려워하지 마세요! 나는 피를 구토하고 지식 맥락을 명확히하는 데 도움이되는 매우 실용적인 마인드 맵을 분류했습니다. 컨텐츠는 매우 완전합니다. 네트워크 아키텍처에서 응용 프로그램 계층, TCP/IP 프로토콜, 서브넷 디비전 및 기타 핵심 포인트에 이르기까지 원칙을 철저히 이해하는 데 도움이 될 수 있습니다. 📈 명확한 논리 : Mindmas 보물, 당신은 드문 기회가 있습니다. 서둘러! 이 마인드 맵을 사용하여 408 컴퓨터 네트워크의 학습 경로에서 바람과 파도를 타고 성공적으로 해변을 얻으십시오! 도움이 필요한 친구들과 공유해야합니다!
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제6장 버스
버스
버스 개요
버스의 기본 개념
버스 정의
버스는 여러 구성요소가 시분할 방식으로 공유할 수 있는 공공 정보 전송 회선의 집합입니다.
두 가지 특성
시간 공유
공유됨
버스 장치
주요 장치
슬레이브 장치
버스 특성
기계적 성질(크기, 모양)
전기적 특성(전송 방향 및 유효 레벨 범위)
기능적 특성(각 전송선의 기능)
시간 특성(신호와 타이밍의 관계)
버스의 분류
온칩 버스
CPU 칩의 내부 레지스터 간, 레지스터와 ALU 간 공통 연결 라인입니다.
시스템 버스
데이터 버스(양방향)
데이터는 실제 데이터, 명령 코드 또는 상태 정보일 수 있으며 때로는 제어 정보일 수도 있습니다.
주소 버스(단방향)
주 메모리 장치 또는 I/O 포트의 데이터 버스에 소스 또는 대상 데이터의 주소를 제공하는 데 사용됩니다.
제어 버스
제어선(편도)
상태 표시줄(단방향)
특정 신호선의 경우 단방향 전송이지만 전체적으로는 양방향 전송입니다.
I/O 버스
중저속 I/O 장치를 연결하는 데 사용되며 I/O 인터페이스를 통해 시스템 버스에 연결됩니다.
통신 버스(외부 버스)
컴퓨터 시스템 또는 컴퓨터와 기타 시스템(예: 제어 기기, 모바일 통신 등) 간의 데이터 통신을 가능하게 합니다.
시스템 버스 구조
단일 버스 구조
단일 버스 구조는 CPU, 메인 메모리, I/O 장치(I/O 인터페이스를 통해)를 일련의 버스에 연결하여 I/O 장치 간, I/O 장치와 메인 장치 간 직접 정보 교환을 허용합니다. 메모리.
DMA 컨트롤러가 등장한 후에는 CPU가 더 이상 유일한 마스터 장치가 아닙니다. DMA 컨트롤러는 마스터 장치로서 시스템 버스 사용 권한을 신청할 수도 있습니다.
듀얼 버스 구조
메인 메모리 버스(호스트 버스)는 CPU, 메인 메모리 등 고속 모듈을 연결합니다. I/O 버스는 키보드, 프린터 등 느린 장치를 연결합니다.
메모리 컨트롤러는 메모리 버스와 시스템 버스를 동시에 연결하는 듀얼 포트 메모리 컨트롤러입니다.
CPU는 스토리지 버스를 통해 메인 메모리에 접근하고, 시스템 버스를 통해 외부 장치에 접근한다. 외부 장치와 주 메모리 사이, CPU와 주 메모리 사이의 데이터 전송은 병렬로 발생할 수 있습니다.
3개의 버스 구조
공통 버스 표준
일반적으로 사용되는 온칩 버스
AMBA 버스
위시본 버스
공통 시스템 버스
ISA
MCA
PCI
공통 I/O 버스
AGP
PCI 익스프레스
SCSI
SAS 버스
일반적으로 사용되는 외부 버스
RS-232-C 및 RS-485
USB
버스 성능 지표
버스 환승주기
버스 클럭 주기
버스 운영 주파수
버스 클럭 주파수
버스 폭
버스 대역폭
버스 다중화
신호선 수
버스 거래 및 타이밍
버스 거래
요청 단계
중재 단계
주소 지정 단계
전송 단계
출시 단계
동기 타이밍 모드
통일된 클록 신호는 송신측과 수신측 간의 전송 타이밍 관계를 조정하는 데 사용됩니다.
비동기 타이밍 모드
타이밍 제어는 서로를 제한하는 "핸드셰이크" 신호를 전송함으로써 완전히 달성됩니다.
정보를 교환하는 두 개의 구성 요소 또는 장치를 마스터 장치와 슬레이브 장치로 나눕니다.
"요청" 및 "응답" 신호의 철회 여부에 따라 비동기 타이밍 방식은 다음과 같은 세 가지 유형으로 구분됩니다.
연동 모드 없음
마스터 디바이스의 요청 신호는 t1 시간 이후 자동으로 취소됩니다.
응답 신호는 t2 시간 이후에도 자동으로 취소됩니다.
반연동 방식
요청 신호의 취소는 두 번의 핸드셰이크가 필요한 응답 신호의 설정에 따라 달라집니다.
슬레이브 장치 응답 신호 ACK가 전송된 후 t2 시간이 지나면 자동으로 취소됩니다.
풀 연동 방식
응답 신호의 취소는 요청 신호의 취소에 따라 달라집니다.
읽기 데이터 주기의 비동기 제어